第3章快速入门
eda 福州大学课件
LIBRARY IEEE; 库、程序包 USE ieee.std_logic_1164.all; USE ieee.std_logic_unsigned.all; ENTITY counter4 IS GENERIC (cntwidth:interger:=4) PORT (ci,nreset,clk:IN std_logic; 实体说明部分 co:OUT std_logic; qcnt:BUFFER std_logic_vector(cntwidth-1 DOWNTO 0)); END counter4; ARCHITECTURE behave OF counter4 IS BEGIN co<=‘1’ WHEN (qcnt=“1111” AND ci=‘1’) ELSE ‘0’; PROCESS (clk,nreset) BEGIN IF (nreset=‘0’) then qcnt<=(others=>’0’); 结构体 elsif(clk’event and clk=‘1’) then if(ci=‘1’) then qcnt<=qcnt+1; 进程 end if; END IF; END PROCESS; END behave; 2
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